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得体会。

原理框图数字钟的构成数字钟实际上是个对标准频率进行计数的计数电路。

由于计数的起始时间不可能与标准时间如北京时间致，故需要在电路上加个校时电路，同时标准的时间信号必须做到准确稳定。

通常使用石英晶体振荡器电路构成数字钟。

晶体振荡器仿真电路时间记数电路般采用进制计数器如等来实现时间计数单元的计数功能。

本次设计中选择。

由其内部逻辑框图可知，其为双异步计数器，并每计数器均有个异步清零端高电平有效。

秒个位计数单元为进制计数器，无需进制转换，只需将与下降沿有效相连即可。

下降没效与秒输入信号相连，可作为向上的进位信号与十位计数单元的相连。

秒十位计数单元为进制计数器，需要进制转换。

将进制计数器转换为进制计数器的电路连接方法如图，其中可作为向上的进位信号与分个位的计数单元的相连。

十进制进制转换电路分个位和分十位计数单元电路结构分别与秒个位和秒十位计数单元完全相同，只不过分个位计数单元的作为向上的进位信号应与分十位计数单元的相连，分十位计数单元的作为向上的进位信号应与时个位计数单元的相连。

制作要求自行装配和调试，并能发现问题和解决问题。

编写设计报告写出设计与制作的全过程，附上有关资料和图纸，有心得体会。

原理框图数字钟的构成数字钟实际上是个对标准频率进行计数的计数电路。

由于计数的起始时间不可能与标准时间如北京时间致，故需要在电路上加个校时电路，同时标准的时间信号必须做到准确稳定。

通常使用石英晶体振荡器电路构成数字钟。

数字钟组成框图晶体振荡器电路晶体振荡器电路给数字钟提供个频率稳定准确的的方波信号，可保证数字钟的走时准确及稳定。

不管是指针式的电子钟还是数字显示的电子钟都使用了晶体振荡器电路。

般输出为方波的数字式晶体振荡器电路通常有两类，类是用门电路构成另类是通过非门构成的电路，本次设计采用了后种。

如图所示，由非门与晶体电容和电阻构成晶体振荡器电路，实现整形功能，将振荡器输出的近似于正弦波的波形转换为较理想的方波。

输出反馈电阻为非门提供偏置，使电路工作于放大区域，即非门的功能近似于个高增益的反相放大器。

电容与晶体构成个谐振型网络，完成对振荡频率的控制功能，同时提供了个度相移，从而和非门构成个正反馈网络，实现了振荡器的功能。

由于晶体具有较高的频率稳定性及准确性，从而保证了输出频率的稳定和准确。

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校时电路数字钟应具有分校正和时校正功能，因此，应截断分个位和时个位的直接计数通路，并采用正常计时信号与校正信号可以随时切换的电路接入其中。

即为用与或非门实现的时或分校时电路，端与低位的进位信号相连端与校正信号相连，校正信号可直接取自分频器产生的或不可太高或太低信号输出端则与分或时个位计时输入端相连。

当开关打向下时，因为校正信号和相与的输出为，而开关的另端接高电平，正常输入信号可以顺利通过与或门，故校时电路处于正常计时状态当开关打向上时，情况正好与上述相反，这时校时电路处于校时状态。

实际使用时，因为电路开关存在抖动问题，所以般会接个触发器构成开关消抖动电路，所以整个较时电路就如图。

带有消抖电路的校正电路整点报时电路电路应在整点前秒钟内开始整点报时，即当时间在分秒到分秒期间时，报时电路报时控制信号。

当时间在分秒到分秒期间时，分十位分个位和秒十位均保持不变，分别为和，因此可将分计数器十位的和个位的和及秒计数器十位的和相与，从而产生报时控制信号。

制作要求自行装配和调试，并能发现问题和解决问题。

编写设计报告写出设计与制作的全过程，附上有关资料和图纸，有心得体会。

原理框图数字钟的构成数字钟实际上是个对标准频率进行计数的计数电路。

由于计数的起始时间不可能与标准时间如北京时间致，故需要在电路上加个校时电路，同时标准的时间信号必须做到准确稳定。

通常使用石英晶体振荡器电路构成数字钟。

数字钟组成框图晶体振荡器电路晶体振荡器电路给数字钟提供个频率稳定准确的的方波信号，可保证数字钟的走时准确及稳定。

不管是指针式的电子钟还是数字显示的电子钟都使用了晶体振荡器电路。

般输出为方波的数字式晶体振荡器电路通常有两类，类是用门电路构成另类是通过非门构成的电路，本次设计采用了后种。

如图所示，由非门与晶体电容和电阻构成晶体振荡器电路，实现整形功能，将振荡器输出的近似于正弦波的波形转换为较理想的方波。

输出反馈电阻为非门提供偏置，使电路工作于放大区域，即非门的功能近似于个高增益的反相放大器。

电容与晶体构成个谐振型网络，完成对振荡频率的控制功能，同时提供了个度相移，从而和非门构成个正反馈网络，实现了振荡器的功能。

由于晶体具有较高的频率稳定性及准确性，从而保证了输出频率的稳定和准确。

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晶体振荡器仿真电路时间记数电路般采用进制计数器如等来实现时间计数单元的计数功能。

本次设计中选择。

由其内部逻辑框图可知，其为双异步计数器，并每计数器均有个异步清零端高电平有效。

秒个位计数单元为进制计数器，无需进制转换，只需将与下降沿有效相连即可。

下降没效与秒输入信号相连，可作为向上的进位信号与十位计数单元的相连。

秒十位计数单元为进制计数器，需要进制转换。

将进制计数器转换为进制计数器的电路连接方法如图，其中可作为向上的进位信号与分个位的计数单元的相连。

十进制进制转换电路分个位和分十位计数单元电路结构分别与秒个位和秒十位计数单元完全相同，只不过分个位计数单元的作为向上的进位信号应与分十位计数单元的相连，分十位计数单元的作为向上的进位信号应与时个位计数单元的相连。

设计要求画出电路原理图或仿真电路图元器件及参数选择电路仿真与调试文件生成与打印输出。

制作要求自行装配和调试，并能发现问题和解决问题。

编写设计报告写出设计与制作的全过程，附上有关资料和图纸，有心得体会。

原理框图数字钟的构成数字钟实际上是个对标准频率进行计数的计数电路。

由于计数的起始时间不可能与标准时间如北京时间致，故需要在电路上加个校时电路，同时标准的时间信号必须做到准确稳定。

通常使用石英晶体振荡器电路构成数字钟。

拉线时，尽量将线紧贴面包板，把线成直角，避免交叉，也不要跨越元件。

第篇机械课程设计心得体会数字电子技术课程设计报告设计目的数字钟是种用数字电路技术实现时分秒计时的装置，与机械式时钟相比具有更高的准确性和直观性，且无机械装置，具有更更长的使用寿命，因此得到了广泛的使用。

数字钟从原理上讲是种典型的数字电路，其中包括了组合逻辑电路和时序电路。

因此，我们此次设计与制做数字钟就是为了了解数字钟的原理，从而学会制作数字钟而且通过数字钟的制作进步的了解各种在制作中用到的中小规模集成电路的作用及实用方法且由于数字钟包括组合逻辑电路和时叙电路通过它可以进步学习与掌握各种组合逻辑电路与时序电路的原理与使用方法设计要求设计指标时间以小时为个周期显示时分秒具有校时功能，可以分别对时及分进行单独校时，使其校正到标准时间计时过程具有报时功能，当时间到达整点前秒进行蜂鸣报时为了保证计时的稳定及准确须由晶体振荡器提供表针时间基准信号。

在这次课程设计过程中，我发现自己还有很多不足之处，在设计和计算过程中也出现了各种各样的，在同学和老师的帮助下也都尽量改正了，虽然还存在或多或少的问题，这也是我今后努力的方向，我会继续努力学习，来丰富自己的知识。

在这段时间的不懈努力下，我了解了在课程设计中应注意的问题注意与工艺规程的衔接，夹具设计应和工序设计统所需设计的夹具绝大多数用于零件加工的特定工序。

在工艺设计环节中，对该工序的设计已要求设计其定位与夹紧方案，因此夹具设计的具体内容应与工序设计保持致，不能相互冲突。

设计时要有整体观念夹具设计有其自身的特点定位夹紧等各种装置在设计前是分开考虑的，设计后期通过夹具体的设计将各种元件联系为个整体。

设计中应学习正确运用标准与规范对于国家标准的规范要严格要求和执行。

夹具设计过程中选择各种功能元件时应注意尽可能选用标准件，减少非标准件的设计制造工作量，降低夹具成本。

总体来说，通过这次设计我受益匪浅。

培养了我的设计思维，增加了实际操作能力，为以后的设计工作打下了较好的基础。

在让我体会到了搞设计艰辛的同时，更让我体会到成功的喜悦和快乐。

最后，我要衷心地感谢老师。

第篇机械设计课程设计心得体会减速机设计减速机设计心得体会通过这次课程设计，由于理论知识的不足，再加上平时没有什么设计经验，开始的时候有些手忙脚乱，不知从何入手。

在老师的谆谆教导，和同学们的热情帮助下，使我找到了信心。

现在想想其实课程设计当中的每天都是很累的，其实正向老师说得样，机械设计的课程设计没付出劳动的成果的彰显，那是自己辛苦过程的体现这种不断上进，认真致的心态也必将导致个人在生活和学习的各个方面做的很完美，有位那种追求的锲而不舍的过程是相同有那么简单，你想或者你想自己胡乱蒙两个数据上去来骗骗老师都不行，因为你的每个数据都要从机械设计书上或者机械设计手册上找到出处。

虽然种种困难我都已经克服，但是还是难免我有些疏忽和遗漏的地方。

完美总是可望而不可求的，不在同个地方跌倒两次才是最重要的。

在社会这样个大群体里面，沟通自然是为人处世的基本，如何协调彼此的关系值得我们去深思和体会在实习设计当中依靠与被依靠对我的触及很大，有些人很有责任感，把这样种事情当成是自己的重要任务，并为之付出了很大的努力，不断的思考自己所遇到的问题而有些人则不付出劳动的成果的彰显，那是自己辛苦过程的体现这种不断上进，认真致的心态也必将导致个人在生活和学习的各个方面做的很完美，有位那种追求的锲而不舍的过程是相同以为然，总觉得自己的弱势其实在生活中这样的事情也是很多的，当我们面对很多问题的时候所采取的具体行动也是不同的，这当然也会影响我们的结果很多时候问题的出现所期待我们