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块时间模块键盘模块时间设定及其显示模块闹铃整点报时设定及其显示模块。
每完成个模块就与前个已完成的模块结合起来调试，直至实现相应功能，再编写下模块程序。
在与主程序衔接时，主程序和各子程序也需作相应的改动，以便与子程序更好的衔接，特别是显示子程序需作较大改动，以便对不同内容进行显示。
软件编译后的结果图软件编译结果图通过上图可以知道，整个设计值用了个逻辑单元，占用很少的资源。
调试过程及结果调试过程按照显示模块时间模块键盘模块时间设定及其显示模块闹铃基于的数字时钟设计整点报时设定及其显示模块的顺序进行调试。
显示模块调试本系统功能完整运行离不开正确显示，所以显示模块的实现非常重要，在联机调试第步就要确定系统的显示是否能够正常运行。
将需要显示的内容编写在程序内，单独得进行仿真。
此模块调试结果如图所示图显示模块调试图时间系统模块调试确定系统显示成功后，进行时间系统的调试。
时间系统需要实现时分秒的正确走时。
显示结果为时分秒，其中秒钟可以正常走动。
此模块调试结果如图所示图时间系统模块调试图按键模块调试按键被按下进入校时状态，按键被按下进入调闹钟状态在闹铃响时按此键能屏蔽闹铃音，在两个不同状态下，三个按键的功能是相同的，当被按下时，时分秒的数值加。
由于图片限制校时状态下和闹钟设定类似不予以截图。
浙江理工大学科技与艺术学院本科毕业设计论文图时间调整闹钟设定模块调试图调试注意事项软件设计时，需要确定好软件设计的思路，即先确定各个功能需要实现的先后，再将各功能模块单独进行编写调试，待各模块功能完善后，再进行总体联合调试。
调试过程中出现了些问题，并解决在进行系统联机调试时，要注意电源是否接通，机的接口和核心板上的下载口是否连接正确。
确定将未使用的引脚设置为三态输入，否则可能会损坏芯片。
显示模块正确调试之后，进行时钟系统的调试过程中，出现时间信息并没有显示在屏幕上，而在对应时间信息的位置上显示的是。
出现此问题时候，首先对硬件进行再次检查，用示波器检查引脚两端是否有信号的输入输出。
结果发现硬件电路连接正确，问题出现在引脚设置的方面。
在设定引脚时，没有选择正确的输出引脚。
通过查找书本，修改输出引脚，解决了这个问题。
时钟模块时，出现秒钟走的过快的现象。
最终发现是分频程序中没有正确的对时钟脉冲信号进行正确的分频。
通过在网络资源和书籍的学习正确的改善了这个问题。
键盘调整时间程序中，出现了无法正常调时情况，按键盘后，时间信息没有改变或者改变过多。
经过检查，找到原因是没有给按键进行按键去抖动。
这说明在编写程序时候要充分了解各芯片内容资料，减少编写小引起对整个程序造成的影响。
闹钟报时和整点报时蜂鸣时间问题。
闹钟报时中，如果闹钟时间到就会闹铃分钟，考虑到实际生活中，闹钟都是可以手动关闭的，于是设定了个闹钟开关键，为了减少系统硬件的繁杂，当系统时间到达闹铃时间和整点报时的时间，蜂鸣器才会响起。
基于的数字时钟设计第六章总结和展望总结在上设计和调试都需要耐心，时钟设计在生活中无处不在，设计的过程要考虑到应用的习惯，设计更人性化的体验，才会是个好的设计。
在语言的学习上还存在些问题，没有深入的学习，对于有些语法，还需要仔细的查找。
如果将这个数字时钟应用于现实生活中，还存在些许的问题。
例如按键太多，操作起来没那么的方便等等。
展望针对数字时钟的设计，通过以上的验证，我们可以知道，对数字时钟来说，其实占用很少逻辑资源，也就意味着如果点制作成的话，成本会非常的低，所以基于这点，整个模块完全可以依附在其他功能产品如内部上，给整个产品增加的优势。
浙江理工大学科技与艺术学院本科毕业设计论文参考文献刘君，常明，秦娟，基于硬件描述语言的数字时钟设计，天津理工大学学报第卷第期，廖日坤，嵌入式应用开发技术白金手册，中国电力出版社。
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基于的数字时钟设计致谢在我进行此毕业论文撰写的过程中，我的导师给了我极大的帮助。
在这里，我要感谢在这些在我毕业设计过程中指导和帮助过我的人。
首先，我要感谢我的指导严格要求。
本论文的选题和撰写都是在她的指导下完成的。
从开始对语言不懂的情况下，慢慢学习，经过段时间的摸索，开始学着在实验板上进行练习操作，才有了长足的进步，最终调试成功老师对于问题思路的指导，都将成为今后工作学习的宝贵精神财富。
在我走向社会，走向工作岗位的过程中，老师给予我的教诲帮助和殷切期望，促使我更加积极追求新的人生目标。
感谢父母直默默地给予我关心和支持，父母的悉心关怀，永远是鼓励我积极向上的不竭动力。
最后，还要感谢和我样即将毕业的同班同学感谢大学四年的同寝室室友感谢那些没有提及姓名，但也同样给予我帮助的老师同学和朋友，浙江理工大学科技与艺术学院本科毕业设计论文附录模块名输入时钟输入按键数码管选择输出引脚数码管段输出引脚蜂鸣器输出端定义数码管输出寄存器定义数码管选择输出寄存器定义显示数据寄存器定义计数寄存器定义计数中间寄存器定义现在时刻寄存器定义设定闹钟秒十位加基于的数字时钟设计秒加秒的十位加分个位加分十位加时个位加时十位加蜂鸣器的计数定时器计数器加，浙江理工大学科技与艺术学院本科毕业设计论文计数器清零取反输出信号，中音的分频系数值中音的分频系数值中音的分频系数值中音的分频系数值中音的分频系数值中音的分频系数值中音的分频系数值中音的分频系数值，高音的分频系数值闹铃使能控制，
关于多功能的数字时钟研究毕业设计论文
