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为计数允许信号,在信号的上升沿时刻计数模块开始对输入信号的频率进行测量,测量时间恰为个时钟周期正好为单位时间,在此时间里被测信号的脉冲数进行计数,即为信号的频率。
然后将值锁存,并送到数码管显示出来。
设置锁存器的好处是使显示的数据稳定,不会由于周期性的清零信号而不断闪烁。
在每次测量开始时,都必须重新对计数器清。
测频控制信号发生器源程序如下测频控制时钟计数器时钟使能计数器清零输出锁存信号时钟二分频,产生计数器清零信号测频控制产生器如图,图中接的的的信号,为计数允许信号,接计数器的,信号用于在每次测量开始时,对计数器进行复位,接计数器的,接锁存器的。
图的封装图测频控制信号发生器的工作时序图,控制模块的几个控制信号的时序关系图如图所示。
图的时序仿真图从图中可看出,计数使能信号在的高电平后,利用其反相值的上跳沿产生个锁存信号,随后产生清信号上跳沿。
为了产生这个时序图需首先建立个由触发器构成的二分频器,在每次时钟上升沿到来时令其翻转。
其中,控制信号时钟的频率取,而信号的脉宽恰好为,可以用作闸门信号。
此时,根据测频的时序要求,可得出信号和的逻辑描述。
由图可知,在计数完成后,计数使能信号在的高电平后,利用其反相值的上跳沿产生个锁存信号,后,产生个清零信号上跳沿。
锁存器锁存器模块也是必不可少的,测量模块测量完成后,在信号的上升沿时刻将测量值锁存到寄存器中,然后输出到显示模块。
锁存器是起数据保持的作用,它将会把数据保存到下次触发或复位。
主要是主从触发器组成的。
用于存储数据来进行交换,使数据稳定下来保持段时间不变化,直到新的数据将其替换。
锁存器源程序如下,锁存输入数据锁存器的封装如图,图中接控制测频产生器的,而接计数器的,接显示器的端。
图的封装图位锁存器的工作时序图如图。
图的时序仿真图本程序是用来实现锁存器模块的功能,但它的程序相当简单,在锁存信号的上升沿到来时,锁存器将测量值锁存到寄存器,然后输出到显示模块。
但从仿真图中可以明显的看出,锁存输出并不是立即进行的,而是经历了个短暂的延时,这是由于硬件引起的。
十进制计数器计数器模块是由个带有同步清零端,进位信号输出的模为的计数模块级连而成。
此十进制计数器的特殊之处是,有时钟使能输入端,用于锁定计数器。
当高电平计数允许,低电平时计数禁止。
计数器模块用于对输入信号的脉冲进行计数,该模块必须有计数允许异步清零等端口,以便于控制模块对其进行控制。
十进制计数器源程序如下计数时钟信号清零信号计数使能信号位计数结果输出计数进位计数器异步清零手能力,也提高了我处理问题的能力,并且学会了许多新的知识,总的来说,算。
三位码加法器电路带显示电路三位码加法器是基于位码的加法器的原理上连接的,十进制数的个位相加大于,则码的加法器就向高位产生个进位,输出为,若无输出,则为,这样就可以通过三位串行进位加法器进行加法计算。
这里三个十进制受益匪浅,致谢通过两个多月的努力,参阅了大量的文献专著和资料,才使我有了较为清晰的思路来完成本课题的设计。
设计也引用了其中的部分内容,在此,对这些文献专著和资料的作者和编著们表示感谢。
在这里同时也要非常感谢指导老师冷爱莲老师,感谢她自始至终以严谨的治学作风和崇高的责任心给予了我全面的指导,特别是在程序编译和仿真的过程中我遇到了很多弄不懂的,正是有了冷老师的指点我的毕业设计才得以顺利进行。
而且在整个设计的撰写过程中出现的问题冷老师也给予了及时的指正,最后我的设计才得以顺利完成。
在设计撰写和设计模块的仿真过程中,我也得到了很多同学和朋友的帮助与支持,在这里并表示感谢。
同时,也向我的家人致以真心的谢意,他们在我的大学阶段中给予我的切是无法用言语来表达的。
最后,衷心感谢在百忙之中参与评阅我的设计的各位老师,谢谢,参考文献章彬宏应用技术北京理工大学出版社,杨刚等现代电子技术与数字系统设计电子工业出版社,张亦华等数字电路入门程序实例集北京邮电大学出版社,顾斌等数字电路设计西安电子科技大学出版社,年姜立东语言程序设计及应用第二版北京邮电大学出版社,潘松实用教程电子科技大学出版社,刘爱荣等技术与开发应用简明教程清华大学出版社,唐俊英技术应用实例教程电子工业出版社,何伟现代数字系统实验及设计重庆大学出版社,林明权数字控制系统设计范例电子工业出版社,等于,则计数器清零进位输出的封装如图,其中为复位接的端,接的端,接锁存器的端。
图的封装图有时钟使能的十进制计数器的工作时序仿真如图。
图的时序仿真图此程序模块实现的功能是带使能端的进制计数。
程序要求只有当使能端信号为高电平时计数器才能正常工作,每个时钟的上升沿到来时计数器加,因为这里要实现的是进制计数,所以当计数到时计数器清零,同时产生进位信号,这里的进位信号仅为个脉冲信号,旦计数从变为,脉冲信号立即变为低电平。
同时该计数器也应带有清零信号,旦清零信号为高电平,计数器立即清零。
显示模块显示模块设计有段码和位码之分,所谓段码就是让显示出八位数据,般情况下要通过个译码电路,将输入的位进制数转换为与显示对应的位段码。
位码也就是的显示使能端,对于共阳级的而言,低电平使能,在本设计中设计了个位的循环计数器,将计数结果输入到译码器,译码结果输出即可依次使能每个。
例如要让个同时工作显示数据,就是要不停的循环扫描每个,并在使能每个的同时,输入所需显示的数据对应的位段码。
虽然个是依次显示,但是受视觉分辨率的影响,看到的现象是个同时工作。
模块的顶层图如下所示。
计数产生动态扫描信号位码,译码模块用于查表产生段码输出。
显示模块源程序如下切断此要进行修正和数的条件为图和数大于的卡诺图由此得到具有修正电路的位码加法电路如图所示图位码加法器电路由此我们可以通过三个位码加法电路的级联组成个三位串行进位并行加法器,这样通过低位向高位产生进位进行十进制的加法运用是产生测频所需要的各种控制信号。
控制信号的标准输入时钟为,每两个时钟周期进行次频率测量。
该模块产生的个控数相 目录 第章概述 项目概况 二编制依据 第二章项目建设背景 报废汽车数量日益增多 二报废汽车回收拆解再利用是建 据,年,实现地区生产总值亿元,按可比价 格计算,比上年增长三次产业结构由上年的优化为,二 三产业比重比上年提高个百分点,工业化率由上年的提值的增长有着密切的联系。
随着经济的持续快速发展以及人民群众收入水平的不断提高,将 有越来越多的家庭具备购买私人轿车的能力。
废旧汽车量将呈现不断 增长的态势。
经济发展状况式转变建设资源节 约型社会起到积极有效的促进作用。
是社会经济快速发展的客观需求 汽车特别是用于消费的私人轿车保有量的多少,与经济发展经 济活跃程度地区生产总值人均生产总响。
在经济发展到定程度 汽车消费已经进入普通大众居民家庭的时候,说明当地的车市已经成 熟,报废汽车将随时间的推移逐步增多,建设好废旧汽车拆解项目, 将为规范当地汽展水平汽车市场环境, 政策影响等多个因素相互促进相互影式转变建设资源节 约型社会起到积极有效的促进作用。
是社会经济快速发展的客观需求 汽车特别是用于消费的私人轿车保有量的多少,与经济发展经 济活跃程度地区生产总值人均生产总 据,年尽而完备的法律管制以下。
英美法系执行当事人主义,法律对经济活动的约束则显得比较灵活。
三政治环境对会计管理体制的影响国的政治环境也无可避免的影响着会计管理体制的发展变化,国家的很多法规条文都体现着统治阶级的意志,会计管理体制的运行过程在定程度上可以认定为是个政治过程。
任何国家的会计管理体制都必然体现本国的政治要求,体现些经济利益集团的要求。
政府在经济管理中能够起到的作用决定了其在会计制度中所担任的角色,同时决定了会计制度的实施力度。
目前,各国的政治集团并不单存在,而是表现为多种力量相互竞争和较量。
多个相对强大的实力团体共同存在,使得企业的所有利益相关者的利益备受关注。
为了适应格局的变化会计管理体制的内容也要相应的发生变化。
大多学者认为,经济转轨国家的政府在推动市场化方面起着至关重要的作用,因此会计管理体制的改革执行势必受到政府的影响。
第二章我国会计管理体制的发展变化改革开放以来我国会计管理形式的演变顺应我国历史发展的需要,新中国的会计股那里体制是和我国的财政财务管理体制密切相关的,属于典型的政府主导型会计管理体制。
它是伴随着我国的政治体制经济体制的建立和发更高的要求。
对我市而言,主要是土地政策和产业政策带来 的影响较大。
比如动了万村千乡市场工程,力 争到年年底在全国建设万家农村超市。
我们怀 化是山区农业大市,完全可以争取更多的政策扶持。
五新轮湘西地区开发全面启动。
省委省政府已经 出台的湘西地区开发万农民工农业 部的百万中专生计划,计划用年时间为农村培养 万名中专人才国务院扶贫办提出,在十五扶贫开发 中,要确保每个贫困农户有个劳动力接受培训。
拉动农村 消费方面年商务部启资保障机制国家将逐步提高新型合作医疗制信号,分别为信号用于在每次测量开始时,对计数器进行复位,以清除上次测量的结果,该复位信号高电平有效,持续半个时钟周期的时间。
为计数允许信号,在信号的上升沿时刻计数模块开始对输入信号的频率进行测量,测量时间恰为个时钟周期正好为单位时间,在此时间里被测信号的脉冲数进行计数,即为信号的频率。
然后将值锁存,并送到数码管显示出来。
设置锁存器的好处是使显示的数据稳定,不会由于周期性的清零信号而不断闪烁。
在每次测量开始时,都必须重新对计数器清。
测频控制信号发生器源程序如下测频控制时钟计数器时钟使能计数器清零输出锁存信号时钟二分频,产生计数器清零信号测频控制产生器如图,图中接的的的信号,为计数允许信号,接计数器的,信号用于在每次测量开始时,对计数器进行复位,接计数器的,接锁存器的。
图的封装图测频控制信号发生器的工作时序图,控制模块的几个控制信号的时序关系图如图所示。
图的时序仿真图从图中可看出,计数使能信号在的高电平后,利用其反相值的上跳沿产生个锁存信号,随后产生清信号上跳沿。
为了产生这个时序图需首先建立个由触发器构成的二分频器,在每次时钟上升沿到来时令其翻转。
其中,控制信号时钟的频率取,而信号的脉宽恰好为,可以用作闸门信号。
此时,根据测频的时序要求,可得出信号和的逻辑描述。
由图可知,在计数完成后,计数使能信号在的高电平后,利用其反相值的上跳沿产生个锁存信号,后,产生个清零信号上跳沿。
锁存器锁存器模块也是必不可少的,测量模块测量完成后,在信号的上升沿时刻将测量值锁存到寄存器中,然后输出到显示模块。
锁存器是起数据保持的作用,它将会把数据保存到下次触发或复位。
主要是主从触发器组成的。
用于存储数据来进行交换,使数据稳定下来保持段时间不变化,直到新的数据将其替换。
锁存器源程序如下,锁存输入数据锁存器的封装如图,图中接控制测频产生器的,而接计数器的,接显示器的端。
图的封装图位锁存器的工作时序图如图。
图的时序仿真图本程序是用来实现锁存器模块的功能,但它的程序相当简单,在锁存信号的上升沿到来时,锁存器将测量值锁存到寄存器,然后输出到显示模块。
但从仿真图中可以明显的看出,锁存输出并不是立即进行的,而是经历了个短暂的延时,这是由于硬件引起的。
十进制计数器计数器模块是由个带有同步清零端,进位信号输出的模为的计数模块级连而成。
此十进制计数器的特殊之处是,有时钟使能输入端,用于锁定计数器。
当高电平计数允许,低电平时计数禁止。
计数器模块用于对输入信号的脉冲进行计数,该模块必须有计数允许异步清零等端口,以便于控制模块对其进行控制。
十进制计数器源程序如下计数时钟信号清零信号计数使能信号位计数结果输出计数进位计数器异步清零手能力,也提高了我处理问题的能力,并且学会了许多新的知识,总的来说,算。
三位码加法器电路带显示电路三位码加法器是基于位码的加法器的原理上连接的,十进制数的个位相加大于,则码的加法器就向高位产生个进位,输出为,若无输出,则为,这样就可以通过三位串行进位加法器进行加法计算。
这里三个十进制
