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简易数字频率计设计报告 简易数字频率计设计报告

格式:word 上传:2022-06-24 07:58:41

《简易数字频率计设计报告》修改意见稿

1、“.....在计数器清零信号清零后当计数选通控制信 号有效时开始对待测信号进行计数。如果计数选通控制信号的 宽度为那么计数结果就为待测信号的频率如果计数选通控制信号 的宽度为那么待测信号的频率等于计数结果的倍。 该模块将对输入信号进行十进制计数......”

2、“.....为实现系统功能十进制计数器需要设置三个 输入端即被测信号输入端计数器状态清零端和计数器工作使能 端。需要设置四个输出端即和并由 这四个输出端输出四位码来表示十进制数。需要说明上述十进制计 数器都是满进且进位时计数器清零并重新计数......”

3、“.....与上述电路模块设计样它也只需要先设计个单个的译码器 然后通过连接组合就可构成系统的译码电路模块从而实现系统的译码功 能......”

4、“.....需要设置个输出端即 和它们分别连接段数码管的个显示输入端......”

5、“..... 四个数码管分别由选通信号来选择。被选通的数码管显示数据。 其中为扫描时钟为段控制信号由高位至低位分别接 七个段是位选控制信号。程序中是个计数 器作为扫描计数信号由进程生成进程是段译码查表输出 程序......”

6、“.....主要由脉冲发生器电路测频控制信号发生器电路待测 信号计数模块电路锁存器七段译码驱动电路及扫描显示电路等模块组 成。 图数字频率计组成原理框图 由于是位十进制数字频率计所以计数器需用个段显示译 码器也需用个。频率测量的基本原理是计算每秒钟内待测信号的脉冲个 数......”

7、“.....若的输入频率为则输出信号端输出 个脉宽恰好为秒的周期信号可以作为闸门信号用。由它对频率计的 每个计数器的使能端进行同步控制。当高电平时允许计数低电平时 停止计数并保持所计的数。在停止计数期间锁存信号的上跳沿 将计数器在前秒钟的计数值锁存进位锁存器由段译码器译出 并稳定显示......”

8、“.....锁存信号之后清零信号对计数器进行清零 为下秒钟的计数操作作准备......”

9、“.....上述 三个信号产生的顺序是先提供计数信号这......”

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